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基本情報

出願番号

公開番号

登録番号

出願日

2021/4/12

公開日

2022/10/24

出願人

三菱電機エンジニアリング株式会社

特許権者

三菱電機エンジニアリング株式会社

権利化状況

権利化済

発明の名称

バタフライ演算回路

開放特許情報

技術分野

電気・電子

機能

その他

適用製品

ＦＰＧＡ実装基板

目的

時分割多重化によるハードウェアリソース使用量の削減

効果

乗算器への入力信号の切り替えが高速に行えるようになることで，単位演算時間内に行える切り替え回数を向上させる事が出来，1つの乗算器で単位演算時間内に4回の演算が実行でき，ハードウェアリソースの削減数をさらに高められる。

技術概要

乗算器への入力信号の切り替えが高速に行えるようになることで，単位演算時間内に行える切り替え回数を向上させる事が出来，1つの乗算器で単位演算時間内に4回の演算が実行でき，ハードウェアリソースの削減数をさらに高められる。

実施実績　　　：

無

許諾実績　：

無

特許権譲渡　　：

可

対価条件　：

要

特許権実施許諾：

可

対価条件　：

要

登録者情報

登録者名称

その他の情報